ANTEPRIMA

Rispettando in pieno la tabella di marciada lungo fissata, Motorola ((sforna)) il secon-do nato della famiglia PowerPC, l'MPC603.Con prestazioni paragonabili a quelle del pri-mogenito MPC601 (di cui vi abbiamo giàparlato sul numero 130 di MCmicrocompu-ter) il nuovo processore di questa innovativafamiglia si differenzia dal primo per la suacostruzione semplificata che ne rende favo-revole l'utilizzo in sistemi desktop di fasciabassa e, grazie al basso consumo e all'ali-mentazione a 3.3 V, nei sistemi laptop.

Un solido accordoPowerPC, come noto, è un'architettura

RISC nata da un accordo tra tre grandi co-lossi dell'informatica e della microelettronicamondiale: Apple, IBM e Motorola. Destinataa coprire tutti gli ambienti di calcolo, dai por-tatili ai supercomputer senza dimenticare néi mainframe né gli embedded controller perapplicazioni in real time, questa architettura

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Mo'orolaPowerPC 603

di Andrea de Prisco

(fortemente ispirata all'architettura Powerdei sistemi IBM RS/6000) consentirà dimantenere attraverso tutti questi ambientil'assoluta compatibilità software. Inoltre,grazie alla diretta discendenza dalla preesi-stente architettura Power, le macchinePowerPC possono immediatamente utilizza-re le applicazioni AIX già sviluppate per que-ste piattaforme. Senza contare che, attra-verso opportuni emulatori software facentiparte integrante dell'intero progetto, le mac-chine PowerPC potranno eseguire conperformance più che soddisfacenti ancheprogrammi DOS e Macintosh System 7.

Da Power a PowerPCPower, per chi non lo sapesse, è l'acroni-

mo di Performance Optimized With Enhan-ced RISC. È l'architettura sviluppata da IBMper le sue macchine RS/6000, PowerPC nonè che una implementazione single chip abasso costo di questa architettura e rispetta

i concetti fondamentali delle architetture RI-SC: istruzioni a lunghezza fissa, operazioniregistro-registro, lettura/scrittura registri-me-moria, istruzioni semplici e modi di indirizza-mento elementare, un set di registri esteso,istruzioni anche a tre operandi (non distrutti-ve),

Essendo un processore superscalare, di-spone di tre unità esecutive indipendenti(una branch unit, una integer unit e una floa-ting-point unit) grazie alle quali istruzioni dif-ferenti possono essere eseguite parallela-mente e nel medesimo ciclo di c1ock.

Diversamente dalle comuni architettureRISC, nei processori Power il formato floa-ting point è compreso tra i tipi di dato di pri-ma classe: non viene considerato come unacaratteristica opzionale e trattato da un co-processore, ma è direttamente implementa-to nel set istruzioni del processore stessoesattamente come i tipi di dato standard, in-teri e logici. Power supporta il formato stan-dard floating point IEEE-754, utilizza un setdi 32 registri in doppia precisione che fannoparte dell'unità a virgola mobile e che sonoseparati dai registri generali dell'unità intera.Il set di istruzioni floating point comprendeuna serie di istruzioni «moltiplica-e-somma»che consentono di migliorare drasticamentele prestazioni di molti algoritmi.

Nell'implementazione di PowerPC, il setdi istruzioni di Power è stato ridimensionatoper facilitare la realizzazione di versioni sin-gle chip a basso costo. Contemporanea-mente alcune funzioni sono state eliminateper semplificare la futura realizzazione diversioni superscalari molto aggressive. Inol-tre, l'architettura è stata estesa integralmen-te a 64 bit, per prolungare il ciclo di vita diPowerPC, partendo da una piattaforma suf-ficiente a coprire tutte le esigenze di calcolodei prossimi dieci anni.

Per garantire comunque la totale compati-bilità con le applicazioni Power, tutte le fun-zioni non più residenti possono essere im-plementate attraverso meccanismi di «trap& emulate». A fronte delle relative esempli-ficazioni, troviamo d'altro canto un potenzia-mento del set di istruzioni per schedulareesplicitamente i dati da introdurre ed estrar-re sotto il controllo dell'utente, nonché l'ag-giunta di istruzioni floating point in singolaprecisione (Power supporta solo la doppiaprecisione). Ma il cambiamento più significa-tivo da Power a PowerPC riguarda, comedetto, l'estensione dell'architettura da 32 a64 bit: esisteranno sia PowerPC a 32 che a64 bit, ma tutti i processori saranno in gradodi lavorare a 32. Le versioni a 64 bit avrannouno switch seleziona bile a livello di codiceutente per passare da 32 a 64 bit e vicever-sa. Ciò consentirà alle implementazioni a 32bit di girare anche su quelle a 64 bit con un

MCmicrocomputer n. 135 - dicembre 1993

MOTOROLA POWERPC 603

IMMU

~~IITLBI~

64-BIT

64-BIT

32·BIT ADDRESS BUS

32·/64-BIT DATA

Power Tlme BaseD1sslpatlon Counterl

Contro! DecrementerJTAGICOP Clock

Interface "'ltipll.,

COMPLETIONUNIT

A sinistra è montata la «radiografia" del nuovo processore PowerPC: notare le due cache separate per dati e istruzioni. A destra lo schema a blocchi.

kernel di sistema operativo a 64 bit, permet-tendo nel contempo alle nuove applicazionia 64 bit di utilizzare le vecchie librerie a 32.

MPC603: un'architetturasuperscalare a basso consumo

Come recita il suo depliant, il «PowerPC603 offre le performance tipiche di unaworkstation in un design a basso costo,basso consumo, ideale per computer desk-top, notebook o, più in generale, sistemialimentati a batterie».Grazie alla sua archi-tettura superscalare (comune a tutti i pro-cessori PowerPC) è in grado di eseguire treistruzioni per ciclo di clock grazie alla pre-senza di cinque unità di esecuzione indi-pendenti: unità intera, unità floating point,unità branch, load/store e system register.Realizzato in tecnologia stati c CMOS da0.5 micron su una superficie di 85 millime-tri quadrati e 1.6 milioni di transistor, la ca-ratteristica principale di PowerPC 603 è il

basso consumo. Alla sua massima potenzaconsuma appena 3 W offrendo, per la ver-sione a 66 MHz, performance dell'ordinedei 60 SPECint92 e 70 SPECfp92. All'inter-no del chip è implementato un sofisticatomeccanismo di risparmio energetico chepermette di impostare quattro distinti modidi funzionamento agendo su opportuni re-gistri interni del processore. Il primo, Full-Power, è quello di default e come indica ilsuo nome fa sì che tutte le unità internedel chip siano utilizzate alla massima velo-cità di clock ammessa. Anche in questostato, se viene settato il «dynamic powermanagement», le varie unità non utilizzatevengono automaticamente e dinamicamen-te poste in stato di basso consumo senzaminimamente inficiare le performance.

Il primo dei tre stati Low-Power si chia-ma «Doze» e provoca la disabilitazione ditutte le unità interne ad eccezione della so-Ia logica di controllo bus e dei registri dellabase dei tempiDa questo stato l'MPC603

passa in Full-Power a seguito di un inter-rupt esterno asincrono, di una eccezione disistema, di un reset hardware o software,di una eccezione da timer. Nel secondostato Low-Power, denominato «Nap»,l'MPC603 disabilita anche la logica di con-trollo del bus, riducendo ulteriormente lapotenza assorbita. Anche in questo stato ilritorno al «Full-Power» avviene in pochi ci-cli di clock.

Nel terzo stato Low-Power, non a casodenominato «Sleep», tutte le unità funzio-nali interne vengono disabilitate ed è possi-bile fermare completamente anche il clockdi sistema.

er «resuscitare» dallo stato di Sleep ènecessario abilitare la logica PLL (Phase-Locked Loopl. riattivare il clock di sistema,e solo dopo effettuare un interrupt esterno,una eccezione di sistema, un reset hardwa-re o software o un MCP (Machine CheckInput).

MCmicrocomputer n. 135 - dicembre 1993 191

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versione del popolare viewer di files grafici,ora ulteriormente migliorato..'<THE DRAW 4.61 (GR 205) Nuova versione

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